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Test Circuits and Waveforms
V DS
BV DSS
L
t P
V DS
VARY t P TO OBTAIN
REQUIRED PEAK I AS
V GS
R G
+
-
V DD
I AS
V DD
DUT
0V
t P
I AS
0.01 ?
0
t AV
Figure 15. Unclamped Energy Test Circuit
V DS
Figure 16. Unclamped Energy Waveforms
V DD
Q g(TOT)
L
V DS
V GS
V GS = 10V
I g(REF)
V GS
DUT
+
-
V DD
V GS = 2V
0
Q gs2
Q g(TH)
Q gs
Q gd
I g(REF)
0
Figure 17. Gate Charge Test Circuit
Figure 18. Gate Charge Waveforms
V DS
t ON
t d(ON)
t OFF
t d(OFF)
R L
V DS
90%
t r
t f
90%
V GS
+
-
V DD
0
10%
10%
R GS
DUT
90%
V GS
V GS
10%
0
50%
PULSE WIDTH
50%
Figure 19. Switching Time Test Circuit
Figure 20. Switching Time Waveforms
?2002 Fairchild Semiconductor Corporation
FDB045AN08A0 Rev. C1
6
www.fairchildsemi.com
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